SerDes,GTP , GTX , GTH理解

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SerDes,GTP , GTX , GTH理解

2024-03-27 04:41| 来源: 网络整理| 查看: 265

Verilog基础知识2(FPGA小数运算处理--定点小数)

我也不想抄题: 您好,请问最后输出的20’h18_AB怎么让电脑知道我们的设置格式是(8.8),然后转化为十进制小数,或者用MATLAB生成呢

Verilog基础知识2(FPGA小数运算处理--定点小数)

Nekodays: 作为一个完美主义者的想法: 以8位整型为例, 其实 8位有符号 乘 8位有符号得到的 16位有符号, 中的第14位(权2^14的位, 符号位右边的位), 很讨厌, 它只有在 -128 * -128时才等于1, 其它65535种情况, 全是0, 很浪费. 所以我们一般在数字信号处理系统中, 永远把[-1,1]映射到[-127,127], 这样那个讨厌的第14位永远用不到, 然后就可以: wire signed [15:0] mul = a * b; wire signed [14:0] out = {wire[15], wire[13:0]}, 8位有符号 乘 8位有符号 得到 15位有符号, 节约一位. 请问这段话的含义,大佬可以解释说明一下吗

深度学习FPGA实现基础知识14(如何理解“卷积”运算)

橙小亮: 博主大大借楼,谢谢!这里有卷积神经网络verilog源代码还有讲解:https://www.bilibili.com/video/BV13L411K7ma/

Verilog基础知识2(FPGA小数运算处理--定点小数)

qq_43239211 回复 wssd159: 先将-1.5*256,得到负整数-384。然后按照一般规则将-384转成补码就行

Verilog基础知识2(FPGA小数运算处理--定点小数)

wssd159: 那负数的定点运算呢,比如1.5×-1.5,-1.5该如何用补码表示呢



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