“一生一芯” 项目 WIKI

2023-06-28 15:06| 来源: 网络整理| 查看: 265

“一生一芯” 项目 WIKI¶

“一生一芯” 是一个面向初学者的CPU设计训练项目。

在项目进行期间，我们将定期向参与者发布学习目标和任务，并定期检查参与者的学习、工作进度。

如果您能在截止日期前独立完成一个符合要求的工程，我们将提供免费的流片机会。

Note

由于经费限制，本期一生一芯的流片名额仅对国内在校生开放

项目目标¶ 基础目标¶

实现一个五级流水线、可启动 RT-Thread 的 RV64 处理器核，集成至 SoC 并进行验证，通过测试验收即可流片。

进阶目标¶

能力优秀者可尝试启动Linux或实现乱序多发射；负责 SoC 集成和验证；参与 IC 后端支撑工作，设计可流片版图

项目概览

项目流程基本原则推进流程流片要求参与项目学习过程报名成为助教助教的工作前端设计助教(线上) SoC实习(线下) IC实习(线下) 报名方式参考资料总体原则参考书其它参考资料合作/赞助机构

进度计划

前期准备基础: CPU核心构建与调试 (3个月) Task 1 Task 2 Task 3 Task 4 Task 5 Task 6 Task 7 Task 8 Task 9 进阶: 性能/时序优化、后端流程等

常见问题解答

Verilog 和 Chisel 语言 Verilator Verilator 的优势 System verilog 安装环境 (操作系统) RISC_V 架构

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