Xilinx Vivado2020.2创建MicroBlaze工程生成xsa文件 |
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本教程以Xilinx VCU108 Evaluation Board为例,讲解用Xilinx Vivado 2020.2创建MicroBlaze软核工程,并生成xsa文件 MicroBlaze 是基于Xilinx公司FPGA的微处理器IP核,和其它外设IP核一起,可以完成可编程系统芯片(SOPC)的设计。MicroBlaze 处理器采用RISC架构和哈佛结构的32位指令和数据总线,可以全速执行存储在片上存储器和外部存储器中的程序,并访问其数据。 LogiCORE™ IP AXI 通用异步收发器 (UART) Lite 接口不仅可连接高级微控制器总线架构 (AMBA®) 规范的高级 eXtensible 接口 (AXI),而且还可为异步串行数据传输提供控制器接口。该软 LogiCORE IP 核旨在与 AXI4-Lite协议实现连接。 1、打开Vivado 2020.2,并新建Project 19、点击Generate Block Design
28、bit文件生成成功后,点击Export Hardware,导出xsa文件 |
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