vivado 除法器ip核的使用 |
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根据手册pg-151 Divider Generator v5.1 LUTMult This is recommended for operand widths less than or equal to 12 bits This implementation uses DSP slices, block RAM and a small amount of FPGA logic primitives (registers and LUTs). Radix-2 This is recommended for operand widths less than around 16 bits or for applications requiring high throughput。 The Radix2 solution does not use DSP or block RAM primitives, so this implementation is recommended when these primitives are needed elsewhere. High Radix. High Radix division with prescaling. This is recommended for operand widths greater than around 16 bits. This implementation uses DSP slices and block RAMs. 具体用法见ip除法器手册 通过catalog产生一个除法器ip核 **Algorithm Type:**选择不同的算法模式,其中Radix2为常用的模式,LutMult当时数较小的时候使用,High Radix是当数很大的时候使用。常用的是Radix2,此处也是选择的为Radix2. Dividend Width:被除数的位数。 Divisor Width:除数的位数。 Remainder Type:选择余数的模式。 有两种模式:Remainder:余数,以及Fractional分数模式。 Remainder模式的余数模式位数固定,由系统根据除数自动设定。 而选择Fractional Width模式,则可以在Fractional Width那一栏选择自己想要的余数位数。 常用模式为Remainder模式。本文也应选则Remainder模式。 时钟延迟可以手动设置和默认的自动设置。 附录测试代码: 我自己做的测试顶,也有ip自带的tb可用来仿真,可以右键选择set as top来进行仿真。 时钟频率可以通过改变其中参数来设置。 endmodule //我自己使用的160mhz时钟频率来进行测试 ///自带 div ip的延迟为5-25个时钟周期 24bit/16bit //me use 6 clock cycle 仿真结果; |
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